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【電路設(shè)計(jì)論文】計(jì)算機(jī)數(shù)字電路設(shè)計(jì)技術(shù)與優(yōu)化措施

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1、【電路設(shè)計(jì)論文】計(jì)算機(jī)數(shù)字電路設(shè)計(jì)技術(shù)與優(yōu)化措施 計(jì)算機(jī)技術(shù);高速數(shù)字電路設(shè)計(jì);電路設(shè)計(jì)技術(shù) 1影響計(jì)算機(jī)高速數(shù)字電路設(shè)計(jì)的主要因素 1.1信號(hào)線的距離 隨著數(shù)字電路技術(shù)的日臻成熟,電子設(shè)計(jì)行業(yè)的發(fā)展愈加迅速,計(jì)算機(jī)技術(shù)也隨之得到了改善和提升。但受到各項(xiàng)因素的影響,該技術(shù)仍舊有待完善。在各項(xiàng)問題中,信號(hào)線的距離問題最為突出。該問題會(huì)直接影響電路的正常運(yùn)行,在印刷電路板密集度較高的情況下,信號(hào)線的距離則會(huì)變得比較狹小,二者之間呈反比關(guān)系。由于信號(hào)線距離狹小,所以信號(hào)間的電磁耦合會(huì)逐漸變大,進(jìn)而出現(xiàn)信號(hào)串?dāng)_問題,如果沒有及時(shí)解決,串?dāng)_問題會(huì)逐

2、步擴(kuò)大。 1.2抗組不匹配 在計(jì)算機(jī)高速數(shù)字電路設(shè)計(jì)中,必須要考慮阻抗設(shè)計(jì)的合理性,如果阻抗值與實(shí)際需求不符,則會(huì)對系統(tǒng)信號(hào)的傳輸產(chǎn)生影響。目前來看,阻抗不匹配是高速數(shù)字電路比較常見的問題。在系統(tǒng)運(yùn)行的過程中,如果運(yùn)行不穩(wěn)定,則會(huì)出現(xiàn)反射噪聲,而反射噪聲會(huì)破壞信號(hào),進(jìn)而造成信號(hào)不完整,影響阻抗的匹配性。 1.3電阻與電感不穩(wěn)定 目前,高速數(shù)字化電路設(shè)計(jì)技術(shù)已經(jīng)廣泛應(yīng)用于各個(gè)領(lǐng)域之中,從實(shí)際的應(yīng)用情況來看,在電子技術(shù)的支撐下,電子設(shè)備的運(yùn)行效果有了顯著的提升。目前采用的設(shè)計(jì)方式,即在電源平面范圍內(nèi)具有電阻和電感,由大量電路同時(shí)進(jìn)行輸

3、出,電路中可能會(huì)產(chǎn)生的瞬時(shí)電流較大,進(jìn)而影響了電路地線和電源的適配電壓,導(dǎo)致電路中的電壓產(chǎn)生較大的浮動(dòng),使整個(gè)電路缺少穩(wěn)定性。 2計(jì)算機(jī)高速數(shù)字電路設(shè)計(jì)技術(shù)的優(yōu)化措施 2.1優(yōu)化信號(hào)設(shè)計(jì) 為了確保信號(hào)的完整可靠,在設(shè)計(jì)的過程中需要進(jìn)行合理的電路布局。從目前的情況來看,阻抗不匹配是一個(gè)比較難以根除的問題,要解決該問題可以從以下兩方面入手:首先,深入研究電路信號(hào)在傳輸過程中可能出現(xiàn)的干擾情況,著重研究反射、干擾等問題;其次,加強(qiáng)對信號(hào)源傳輸產(chǎn)生的電路信號(hào)網(wǎng)干擾進(jìn)行研究。為了控制阻抗,可以從不同的方面入手。如:在傳輸線的阻抗控制方面,如果在高頻電路之中

4、,那么傳輸線的抗串?dāng)_、抗輻射等能力都會(huì)高于普通連線。當(dāng)然,其之所以具有相對優(yōu)良的特性,是因?yàn)槠涓冻隽讼鄳?yīng)的電能代價(jià)。從高速電路的角度來看,用電源損耗來獲取信號(hào)質(zhì)量是值得的。傳輸線主要有4種形式,分別是:同軸電纜、雙紐線、表面微帶線、嵌入式帶狀線。后兩種線在印制板中的作用較大,表面微帶線主要在印制板外層分布,信號(hào)線的另一邊為地層;嵌入式微帶線則在電源層和地層中間,理論上該位置的信號(hào)受到的干擾最少,因?yàn)樾盘?hào)線獲得了兩個(gè)夾層的保護(hù)。 2.2優(yōu)化電源設(shè)計(jì) 從電路設(shè)計(jì)的角度來看,減少電源中的阻抗可以提升數(shù)字電路的運(yùn)行效率,信號(hào)回路所消耗的能源也會(huì)隨之減少,系統(tǒng)中各個(gè)元件的

5、電流、電壓都會(huì)保持在穩(wěn)定的狀態(tài)下。在電路中,電源是核心構(gòu)成元件,從前文內(nèi)容可知,電源平面范圍內(nèi)一定會(huì)存在電阻和電感,其會(huì)影響電源的電壓,進(jìn)而出現(xiàn)電壓波動(dòng)的問題,造成運(yùn)行穩(wěn)定性下降。所以為了確保系統(tǒng)的穩(wěn)定可靠,需要從電阻、電感兩個(gè)方面入手,對電源設(shè)計(jì)進(jìn)行優(yōu)化和完善。目前來看高速數(shù)字電路采用的多為銅質(zhì)電源,這些電源材料無法滿足電路的應(yīng)用要求,所以難以保障系統(tǒng)的穩(wěn)定性。在電源層,雖然具有一定的阻抗特性,但并不能完全消除線噪聲帶來的影響。系統(tǒng)產(chǎn)生的線噪聲會(huì)導(dǎo)致系統(tǒng)失穩(wěn),所以電源系統(tǒng)中還要加入濾波電路。通常其由旁路電容來實(shí)現(xiàn),也就是在電源輸入端放入不小于10uF的電容,在各個(gè)器件的電容和地之間放入0.1

6、uF/0.01uF的電容。在輸出端加入大電容,可以過濾板外電源產(chǎn)出的低頻噪聲,頻率約為50Hz/60Hz。板上會(huì)產(chǎn)生不小于100M的噪聲諧波,與電源輸入端上的電容相比,芯片上的旁路電容較小。最好的電容為純電容,但受到內(nèi)部分層結(jié)構(gòu)、引腳結(jié)構(gòu)的影響,其在高頻時(shí)難免會(huì)出現(xiàn)電阻和電感。這些電阻和電感會(huì)對電容產(chǎn)生串聯(lián)干擾,即等效串聯(lián)電阻、等效串聯(lián)電感。所以電容共振頻率的實(shí)際計(jì)算方式為:fr=1/√LC。不論是串聯(lián)電阻,還是串聯(lián)電感,都受到電容器結(jié)構(gòu)、絕緣材料的影響,與電容值并沒有直接關(guān)系。如果要提升高頻通道的能力,不能采用增加同型號(hào)電容的容值的方法來完成。如果頻率范圍低于fr,大電容值電容的阻抗小于小電

7、容值電容的阻抗,反之串聯(lián)電感會(huì)起到主要作用,阻抗并不會(huì)帶來太大的影響。只有在電容結(jié)構(gòu)發(fā)生變化的情況下,串聯(lián)電感才會(huì)發(fā)生變化,需要提升濾波性能,選用串聯(lián)電感較低的電容器。 3結(jié)語 綜上所述,隨著科技的發(fā)展和進(jìn)步,我國的信息化和電氣化水平在不斷提升,電子設(shè)計(jì)行業(yè)也隨之發(fā)展。為了滿足現(xiàn)代社會(huì)的建設(shè)需求,并加強(qiáng)自身的競爭能力,電子設(shè)計(jì)行業(yè)需要不斷創(chuàng)新技術(shù)、完善方法,著重優(yōu)化高速數(shù)字電路設(shè)計(jì)方法,解決設(shè)計(jì)和應(yīng)用中存在的各類問題,如降低阻抗對電路運(yùn)行的影響等。利用現(xiàn)代化的技術(shù)和方法,使高速數(shù)字電路更加完善。 參考文獻(xiàn) [1]蘇江帆.淺談?dòng)?jì)算機(jī)高速數(shù)字電路設(shè)計(jì)技術(shù)及優(yōu)化措施[J].科學(xué)與財(cái)富,2015(21):269. [2]王威.計(jì)算機(jī)高速數(shù)字電路設(shè)計(jì)技術(shù)及優(yōu)化策略[J].通訊世界,2016(20):249-250.

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