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,組合邏輯電路的分析,1,回顧,,門(mén)電路：,Y=AB,Y=A+B,Y=A′,2,回顧,,門(mén)電路：,3,組合邏輯電路的特點(diǎn):,,任意時(shí)刻的輸出僅僅取決于該時(shí)刻的輸入，與電路原來(lái)的狀態(tài)無(wú)關(guān)。 功能特點(diǎn)：無(wú)記憶作用，輸出只取決于當(dāng)前輸入，與電路過(guò)去的狀態(tài)無(wú)關(guān)。 組成特點(diǎn)：能用基本門(mén)構(gòu)成，即任何組合邏輯電路都能用三種基本門(mén)實(shí)現(xiàn)。 結(jié)構(gòu)特點(diǎn)：電路的輸入與輸出之間無(wú)反饋。,4,組合邏輯電路的邏輯函數(shù)表示,,,,邏輯函數(shù)形式,向量形式,5,組合邏輯電路的分析方法,,給定某組合邏輯電路，分析其邏輯功能。步驟為: (1)由所給電路寫(xiě)出輸出端的邏輯函數(shù)式； (2)將所得的邏輯函數(shù)式進(jìn)行化簡(jiǎn)； (3)由化簡(jiǎn)后的邏輯函數(shù)式寫(xiě)出真值表； (4)由真值表分析電路的邏輯功能。,6,實(shí)例,,例1 分析圖1所示電路的邏輯功能。,Bˊ,Aˊ,(AB ˊ) ˊ,(AˊB) ˊ,(AB) ˊ,((AˊB) ˊ(ABˊ) ˊ) ˊ,((AB) ˊ) ˊ,7,實(shí)例,,(1)輸出端的邏輯函數(shù)式,(2)化簡(jiǎn),8,實(shí)例,,(3)真值表,當(dāng)輸入端的值一定時(shí)，輸出的取值也隨之確定，與電路的過(guò)去狀態(tài)無(wú)關(guān)，無(wú)存儲(chǔ)單元。,(4)由真值表可知此電路邏輯功能為半加器。,9,競(jìng)爭(zhēng)-冒險(xiǎn)現(xiàn)象,,檢測(cè) 存在??=??+ ?? ′ 或 ??=??· ?? ′ 如 ??=????+ ?? ′ ??令??=??=?? 消除 修改邏輯設(shè)計(jì)：??=????+ ?? ′ ??+????,兩個(gè)輸入信號(hào)同時(shí)向相反的邏輯電平跳變，輸出端可能會(huì)產(chǎn)生尖峰脈沖。,10,課堂練習(xí),,分析圖2所示電路的邏輯功能。,11,